HSP50016GC-52
50000
PGA/23+
原裝現貨
HSP50016GC-52
50000
PGA/23+
原裝現貨
HSP50016
80000
-/23+
原裝現貨
HSP50016
9000
-/25+
原裝現貨，支持BOM配單
HSP50016
80000
-/23+
原裝現貨
HSP50016
24500
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原裝 部分現貨量大期貨
HSP50016
80000
-/2024+
原裝現貨
HSP50016-EV
58000
NEW/NEW
一級代理保證
HSP50016GC-52
50000
PGA/24+
品牌專營100%原裝房間現貨全網價
HSP50016GC-52
2
PGA/9551+
一定原裝房間現貨
HSP50016GC-52
56000
NEW/NEW
一級代理保證
HSP50016GC-52
52701
PGA/22+
只做原裝,專注海外現貨訂購20年
HSP50016GC-52
65428
PGA/22+
只做現貨，一站式配單
HSP50016GC-52
7420
PGA/23+
只做原裝
HSP50016GC-52
28900
-/21+
低價出售原裝現貨可看貨假一罰十
HSP50016GC-52
50000
PGA/23+
原裝現貨
HSP50016GC-52
6607
-/2024+
現貨假一罰萬只做原廠原裝現貨
HSP50016GC-52
8000
22+/NA
-
HSP50016GC-52
80000
PGA/2023+
一級代理，原廠排單到貨，可開原型號13%專用發票
HSP50016GC-52
1002
PGA/24+
原廠原裝現貨
HSP50016
Digital Down Converter
INTERSIL
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HSP50016
Digital Down Converter
INTERSIL [Intersil Corporation]
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HSP50016-EV
DDC Evaluation Platform
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HSP50016JC-52
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HSP50016JC-75
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INTERSIL
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中頻數字化軟件無線電結構的實用短波軟件無線電接收機中的數字信號處理技術。1 短波軟件無線電接收機的硬件組成 短波軟件無線電接收機的硬件組成如圖1所示。 圖中射頻轉換模塊（rf）包括2個混頻器和相應的模擬濾波器，以產生合適的中頻寬帶信號；模／數轉換部分，采用了二中頻并行a／d轉換方案，所選芯片為ad9240；數字信號處理模塊中的數字下變頻部分，其完成的功能主要有：下變頻、濾除帶外噪聲、降低采樣率等。主要指標有動態范圍、抽取濾波器的性能、頻率分辨率和輸出信號的精度等。所選芯片為harris公司生產的hsp50016； 數字信號處理模塊中的數字信號處理部分，主要完成信息解調、控制射頻前端和接收面板cpu的控制信號等任務。我們要求該部分的微處理器芯片速度快、精度高及具有較多便捷的信息傳輸通路和通信端口。所選芯片為ti公司生產的tms320c31。信號接收過程為：天線接收到的高頻信號(15 khz~30 mhz)以后，與可調本地振蕩器(lo1頻率為：62.5~92.5 mhz)相混頻，得到期望的第一中頻信號(62.5 mhz)，再與本地固定振蕩器(lo2頻率為：62.5 mhz) 混頻產生第二中頻信號(2.5
轉換到中頻（if）上，在中頻對模擬信號進行數字化，然后采用數字下變頻（digital down conversion,ddc）技術，將采樣率較低的信號送給后續的基帶信號處理單元。 實現ddc主要有三種途徑：（1）采用已有的專用芯片；（2）自己制作專用芯片；（3）基于fpga或dsp等通用芯片自建平臺實現ddc。但是在高采樣速率的系統中，如a/d采樣的速率為400mhz時，這三種方法顯示出各自的弊端：商用專用芯片要求a/d團拜轉換出的數據速率較快，比如ad6620要求數據速率小于70mhz，hsp50016要求數據速率小于75mhz；而自己制作專用芯片，由于成本過高和國內技術條件的限制，在小規模的研發生產中幾站是不可能的；用dsp芯片自建平臺實現ddc時，雖然dsp可以高速執行乘加指令，但由于dsp是串行執行指令的，在高速片中會遇到處理能力過低的問題；雖然用fpga片內資源可以同時進行多個乘加運算，但是用fpga片內資源實現的乘法器速度較慢，很難實現高速數據流的實時乘加處理。 本文介紹一種基于新型fpga的高速數字下變頻的實現方法，它充分利用數字下變頻的優化算法以及fpga領域的新技術，去除
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