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深圳市捷力華電子科技有限公司
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嚴(yán)選現(xiàn)貨
嚴(yán)選現(xiàn)貨= 現(xiàn)貨+好口碑+品質(zhì)承諾
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1. 表示供應(yīng)商具有較高市場(chǎng)知名度，口碑良好，繳納了2萬保證金，經(jīng)維庫認(rèn)證中心嚴(yán)格審查。
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MAX12557的原理設(shè)計(jì)和布局指導(dǎo)
一步整形。在評(píng)估板上，為了提高上升和下降速度，我們采用一個(gè)中心抽頭的變壓器提升輸入時(shí)鐘幅度，然后再用二極管將擺幅限制在1.4vp-p。對(duì)于單端時(shí)鐘，邊沿應(yīng)盡量陡，并且滿足數(shù)據(jù)資料規(guī)定的最高和最低電壓要求，即邏輯高電平為0.8vdd (最小)，邏輯低電平為0.2vdd (最大)。時(shí)鐘共模電壓(1/2vdd)由內(nèi)部提供。推薦的接口電路/驅(qū)動(dòng)器邏輯：任何邏輯系列，包括cmos、lvpecl和lvds，都可用于驅(qū)動(dòng)時(shí)鐘輸入。對(duì)于要求特別高的高頻輸入信號(hào)應(yīng)用，建議采用非常高速的lvpecl時(shí)鐘分配電路，如max9320 pecl緩沖器。 (引腳23-26, 61-63, vdd)：最好將0.1µf的旁路電容放在器件引腳旁。 (引腳27, 43, 60, ovdd)：最好將0.1µf的旁路電容放在器件引腳旁。數(shù)據(jù)線b (引腳28-41)和數(shù)據(jù)線a(引腳44-58)：對(duì)于數(shù)據(jù)輸出引腳，應(yīng)盡量縮短從adc到緩沖器或負(fù)載ic的走線長(zhǎng)度。串聯(lián)電阻盡可能靠近adc放置，為確保最佳性能，應(yīng)考慮>10pf的總負(fù)載電容。緩沖器或負(fù)載ic有一個(gè)背向max12557 ep地的實(shí)地，對(duì)于實(shí)