EPF10K20RC208-3
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意可編程分頻器是用來實現對40mhz時鐘信號的任意分頻,它實現的分頻值由輸入的初始值d[width-10]所決定。這里取width=10,則能實現2~1024的分頻。也可以根據電路的不同要求,選擇不同的width值,實現不同的分頻。由于采用altera公司的可編程器件,用ahdl硬件語言描述的分頻器代碼如下: 在max plus ii軟件中進行仿真,設定data[70]的值為5,即為5分頻,輸出波形even如圖3所示。 3 vxi總線接口設計 采用altera公司的flex系列的epf10k20rc208-3的fpga實現寄存器基接口芯片。由于該器件集成度高,可方便地改變邏輯,而且對邏輯設計可事先進行功能模塊和定時模擬,因而使得接口設備更輕松,調試更方便。接口電路實現了如下功能:①內部集成了vxi總線所需的寄存器,由地址信號a1~a5為各個寄存器譯碼分配地址,寄存器類型分別為id寄存器、儀器類型寄存器、狀態/控制寄存器、控制寄存器。②數據總線驅動器,其功能為將p1連接器上的16位數據線d0~d15送至模塊內部數據總線dbd~db15或反之。可用兩個8位三態雙向緩沖器組成。用read控制數據傳遞方向,
和term請求終止傳輸,在第5個數據也是最后一個數據傳輸完成后,總線交易結束。這兩個時序圖屬于傳輸最后一個數據并斷開連接情形的兩種不同情況。仿真波形的分析表明,從設備接口模塊符合pci規范的要求。 圖3 內存突發讀訪問的時序仿真波形 圖4 內存突發寫訪問的時序仿真波形 4 結束語 將一個fifo模塊連接到pci從設備接口的用戶總線組成測試平臺,由fifo的狀態和控制信號提供同步的ready和term信號。這個測試平臺在max+plusii下編譯,并下載到pci開發板上一片epf10k20rc208-3芯片中,安裝驅動程序后,pci開發板正確識別、工作穩定、讀、寫數據準確無誤;多組數據傳輸測試,測得數據突發傳輸率約可達到20 mb·s-1.