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a開發環境quartusii 9.0中的megawizard plug-in manager工具，來生成設定大小為4 kb的片上ram。eda開發工具生成的片上存儲文件僅是具有相關存儲器地址、數據及讀寫控制信號的一個hdl描述文件。為了能夠在本soc系統中使用，需要將其包裝成符合wishbone總線接口的一個從設備，以掛接在系統的wishbone總線上。 3.3 片外存儲控制器的配置 在該soc系統上，片外存儲控制器主要有sdram、flash、ssram控制器。根據臺灣友晶公司的de2-70開發板上實際存儲芯片的需要，對控制器的數據總線寬度與地址總線寬度作相應的修改與定制。一般情況下，sdram作為系統的主存儲器，flash用來存儲系統的一些固化程序。在對一些實時系統進行時間參數測量的過程中，為了減小程序運行空間中時序的不穩定性影響，一般情況下測試程序都是在ssram器件中運行的。 作為存儲器件的物理芯片，數據總線的端口基本上都是雙向的，而在片內系統中數據端口基本上都是單向的。這些片外存儲控制器在進行物理板級的連接時需要對相應的數據端口作處理。以flash控制器為例，數據總線
據dds整體電路的工作原理框圖，其核心是由一個rom存儲器、一個相位累加器、一個鎖相環和相應的輸入、輸出信號組成。其中rom查找表是輸入地址是相位累加器的高11位，這在工程上是允許的。dds的核心電路模塊圖如圖4所示。 方波和脈沖信號的產生只要將rom查找表中的內容轉換為相應的波形即可，整個信號源的頂層模塊增加了多路選擇開關。 3 波形仿真及硬件驗證 完成dds電路設計后，對電路進行了功能仿真，通過matlab顯示了仿真波形，并通過altera公司cycloneⅱ系列芯片的de2-70開發板結合嵌入式邏輯分析儀進行了硬件驗證。 3．1 波形仿真 dds電路在設計過程中，進行了功能仿真，如圖5所示。由于仿真波形為數字碼，不能直觀地看出dds輸出的波形，為便于調試設計電路，首先生成．tbl文件，再通過相應matlab程序生成的正弦波、方波、脈沖信號的波形曲線，如圖6所示。 圖5和圖6顯示了頻率控制字為68h產生的正弦波、頻率控制字為346h的方波和頻率控制字為27fh的脈沖信號的功能仿真波形。從功能仿真波形可以看出，dds電路能夠很好地產生電路板檢測儀所需激勵信
bit×32 bit的dsp乘加操作的能力。or1200默認配置有100萬個晶體管。 2 系統的總體方案 本文構建以or1200微處理器為核心，包含軟硬件平臺的嵌入式soc系統。硬件系統以開源32位risc核+wishbone總線為主干，進行增量迭代開發，將仿真驗證過的模塊逐個加入到or1200嵌入式系統中，然后在fpga上進行驗證。軟件部分進行交叉編譯環境的建立、操作系統的移植、應用程序開發并利用驅動程序、函數庫，經交叉編譯工具最后生成可執行程序下載到內存中。最后在altera的de2-70開發板上驗證系統能否穩定運行。系統開發流程如圖1所示： 主函數中3個任務函數非常簡單，優先級從高到底分別為1、2、3,系統提供的函數ostimedly（）分別為10、20、30,ostimedly（）是將1個任務掛起，延時若干個時鐘節拍，cpu可以去執行其它任務。 圖4給出的是通過串口工具輸出μc/os-ii多任務調度的信息，3個任務根據優先級和延遲時間正確執行并打印出執行信息，測試證明or1200嵌入式soc系統能夠穩定的運行μc/os-ii. 3 硬件平臺的
摘要：為了使便攜式心電監護儀具有友好的人機交互和方便的顯示，移植了一個gui界面系統。以de2-70配套開發板為驗證平 臺，tftlcd ip核是在quartusⅱ9．0軟件平臺下，使用verilog在fpga上用硬件邏輯電路進行設計。該ip核是利用quartusⅱ開發和其集成的 sopc builder系統開發工具而設計的。μc／gui則是在配套開發軟件niosⅱide中進行移植實現。實驗結果表明，μc／gui界面系統成功運行在開 發板上，可實現窗口管理、在指定位置顯示文字和顯示圖片等功能。 便攜式醫療監護儀已成為人們日常生活中不可缺少的一部分。便攜式設備是由硬件與軟件緊湊組合的一個單元模塊，是一種體積小、智能化程度高、功能全、使用靈 活、操作方便的便攜機，適合家庭使用、外出攜帶等用途。為了使便攜式心電監護儀實現友好的人機交互和更加方便的顯示，這里提出一種gui界面系統設計，就 是在基于niosⅱ處理器的嵌入式平臺上實現μc／gui的移植，使之實現系統功能。 1 μc／gui的系統移植 1．1 μc／gui簡介及可移植性分析 μc／gui是micrium公司開發
摘要：基于fpga的應用技術，采用altera公司de2-70開發板的cycloneⅱ系列ep2c70作為核心器件，設計了一種基于fpga的新型可調信號發生器。通過quartusⅱ軟件及vetilog hdl編程語言設計lpm_rom模塊定制數據rom，并通過地址指針讀取rom中不同區域的數據，根據讀取數據間隔的不同，實現調整頻率功能，該系統可產生正弦波、方波、三角波和鋸齒波4種波形信號，并使用嵌入式邏輯分析儀對產生的不同波形信號進行實時測試，實驗證明，該可調信號發生器系統軟件模擬數據和理論定制波形相吻合。 傳統信號發生器大多由模擬電路構成，存在連線復雜、調試煩瑣且可靠性較差等缺點。以verilog hdl編程語言和fpga器件為核心的可調信號發生器的設計實現，提高了系統可靠性，實現了系統信號實時快速測量，也為其廣泛應用于實際領域創造了條件。 1 系統總體設計 可調信號發生器系統由頂層模塊、ep2c70器件、控制開關和輸入輸出模塊等部分組成，如圖l所示。在fpga中實現的頂層文件包含地址指針和數據rom2部分。其中，數據rom由quartusⅱ軟件中的lpm_rom模塊
altera公司近日宣布，在北京大學軟件與微電子學院無錫產學院成立新的聯合實驗室 (eda/sopc)。這是altera與中國大學一起建立的第66家聯合實驗室和培訓中心。作為altera全球大學計劃的一部分，該聯合實驗室配備了最新的altera quartus ii設計軟件和40套altera de2-70開發套件，以幫助教師指導學生進行實踐練習。 學院將利用聯合實驗室完成相關課程的培訓，包括數字邏輯電路、hdl語言、計算機原理、電視原理以及altera fpga開發環境下的現代數字系統設計等。實驗室還可以用于幫助本科生和研究生學習電子電路設計。 北京大學軟件與微電子學院院長張興教授說：“該聯合實驗室的成立，通過教學、研究項目及培訓等方面的合作，可以充分發揮altera與北京大學各自的優勢，將校企雙方的合作更加深入地推進，為推動中國sopc設計領域的發展做出貢獻！” 其他65家聯合實驗室的主要研究人員受邀出席本次聯合實驗室的落成典禮，并參加了為期三天的altera產品和技術培訓。 altera公司大學計劃全球總監stephen brown表示：“通過大學計劃，我
2009年8月13號，北京--altera公司(nasdaq:altr)今天宣布，在北京大學軟件與微電子學院無錫產學院成立新的聯合實驗室 (eda/sopc)。這是altera與中國大學一起建立的第66家聯合實驗室和培訓中心。作為altera全球大學計劃的一部分，該聯合實驗室配備了最新的altera® quartus® ii設計軟件和40套altera de2-70開發套件，以幫助教師指導學生進行實踐練習。 學院將利用聯合實驗室完成相關課程的培訓，包括數字邏輯電路、hdl語言、計算機原理、電視原理以及altera fpga開發環境下的現代數字系統設計等。實驗室還可以用于幫助本科生和研究生學習電子電路設計。 北京大學軟件與微電子學院院長張興教授說：“該聯合實驗室的成立，通過教學、研究項目及培訓等方面的合作，可以充分發揮altera與北京大學各自的優勢，將校企雙方的合作更加深入地推進，為推動中國sopc設計領域的發展做出貢獻！” 其他65家聯合實驗室的主要研究人員受邀出席本次聯合實驗室的落成典禮，并參加了為期三天的altera產品和技術培訓。 altera公
altera公司日前宣布，altera在今年九月成為首家外資公司與西藏大學共同成立一個fpga實驗室。西藏大學位于西藏拉薩，有超過12,000名學生，是一所享有盛名的學府，并且是西藏地區唯一被國家列入211項目名單之內的高等學府。該項目是培養中國的高級別的精英大學，目的是配合經濟和社會的發展策略。這足以證明西藏大學在科學，技術和人力資源方面，已達到相當水平，符合中國政府設定的標準。 該聯合實驗室是世界上海拔最高的fpga實驗室，備有33套altera cyclone ii fpgas的de2-70開發套件裝備。這是altera在中國的第84個聯合實驗室，并且是altera大學計劃成功的證明。altera中國大學計劃經理徐平波評論說：“altera大學項目的影響力已覆蓋到偏遠中國地區，并獲得全國大多數的大學認同，而教育和培訓這方面一直是altera在中國的首要任務。” 西藏大學副校長婁源冰教授評論說：“這是一個極大的貢獻，在中國整體fpga的應用上 。聯合實驗室使工程設計學生建立自己的專業知識，尤其在fpga的結構和設計。聯合實驗室有助中國在日益競爭激烈的全球電子市場上，獲得優越的成
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