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實際的FIFO存儲器
作為實際的fifo存儲器，我們以cypress公司的cy7c419為例進行說明。cy7c419是l0b字×9位結構的fifo存儲器，其引腳配置如圖1所示。在與cy7c419相同的系列中，還包括內部結構為512字×9位（cy7c421）以及1k字×9位、2k字×9位、4k字×9位（分別為cy7c425／429／433）的產品。由于fifo存儲器沒有地址引腳，因而無論哪種產品都具有完全相同的引腳配置，所以該存儲器可以互換使用。圖1 cy7c419的引腳配置 cy7c419的框圖如圖2所示，可以看出這是與剛才的fifo印象圖非常相似的形式。在前面的圖中沒有出現的是處于下半部分的復位邏輯、標識控制電路以及擴展邏輯這三項。對此，我們將進行簡單的補充說明。圖2 cy7c419的內部框圖 1. 復位邏輯如前所述，fifo存儲器沒有地址引腳，訪問的地址由存儲器內部的讀指針及寫指針進行管理，從外部既不能讀出也不能置換該指針。所以，在接通電源及系統復位的情況下，決定fifo存儲器初始狀態的就是復位邏輯,通過mr（master reset，主復位）及fl／rt（fir
用FIFO實現DSP間的雙向并行異步通訊
內容摘要：介紹了利用cypress公司的fifo芯片cy7c419實現dsp間雙向并行異步通訊的方法,該方法簡單實用,速度快,特別適用于小數據量的數據相互傳送。文中給出了cy7c419的引腳功能以及用fifo實現dsp間雙向并行異步通訊的硬件結構和軟件流程。在多cpu的分布式信號處理系統中,往往涉及cpu間的通訊與數據交換,大數據量的數據傳輸一般采用dma方式,而小數據量的數據交換采用并行接口則比較快速靈活。因此,對于傳輸速度要求較高的dsp間的小數據量的數據交換及通訊來說,要提高dsp的工作效率,不僅要求并行接口的響應快,而且必須采用異步方式以免相互等待。本文介紹了采用cypress公司的fifo芯片cy7c419來實現dsp間的雙向并行異步通訊接口。該方法不僅比用ttl鎖存器的方式速度快,而且譯碼邏輯簡單,另外,由于fifo芯片有一定的深度(256個),因此,在少于256個數據傳輸時,可實現零等待時間。 1 fifo芯片簡介全滿（ff）和全空（ef）標志用以防止數據溢出或不足; 擴展輸入（xi）、擴展輸出（x0）、首次裝載（fl）：用以實現無限的寬度及深度擴展,深

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