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,使用可編程邏輯器件cpld構建控制器,可將圖像數據寫入幀存儲器,解決圖像幀合成問題。為了向前端處理器(dsp)提供連續的圖像信號,采用兩個圖像幀存儲器a和b交替存儲的方式,來暫存采集到的圖像數據和需要處理的圖像數據,可實現圖像的實時連續采集處理。 dsp與saa7113之間的硬件接口如圖3所示,整個接口的控制邏輯,包括兩個子模塊:幀圖像寫入控制器和乒乓開關,由一塊cpld來完成。cpld芯片采用altera公司的epm9320rc208。兩組幀存儲器a和b采用cypress公司生產的兩塊cy7c1049芯片,容量為512k×8bit,存取時間不超過15ns,能滿足圖像實時采集要求。 saa7113由數字視頻輸出口vpo[7:0?]輸出視頻數據。系統設置saa7113的輸出數據為標準的itu 656 4:2:2 yuv格式,每一個象素的數據由兩個連續的字節表示。為了方便地存儲處理圖像,系統僅取一幀圖像中間的512×512個象素作為一幀,即所取圖像幀為連續奇偶兩場圖像的中央512行,且每行取中間的512個象素的圖像塊。 利用saa7113的同步信號,幀圖像寫入控制器模塊產生幀存儲器的地
32位數據的高速數據傳輸; ●靈活的程序加載可實現在系統編程; 一般情況下,s5933和dsp之間的硬件連接就是利用dsp的讀寫信號r/ w、地址選通控制信號iostrb、外部設備就緒信號rdy和部分地址信號以及s5933的fifo狀態信號wrfull來進行簡單的時序和邏輯組合,從 而生成對s5933外加總線接口的讀寫控制信號。 2.2 其它器件的選擇 本系統中的cpld芯片選用altera公司的epm9320rc208。兩組幀存儲器a和b采用cypress公司生產的兩塊cy7c1049芯片,該 芯片的容量為512k×8bit,存取時間不超過15ns,能滿足圖像實時采集要求。通過cpld內部的一個乒乓開關控制模塊可自動完成幀間 讀寫兩個通道接口的切換。而dsp和saa7113之間的所有控制信號接口邏輯和時序轉換都由cpld來完成,并可編程修改,因而提高了系統的使用靈活性 和可靠性。 saa7113的作用是實現模擬圖像的a/d轉換。dsp與saa7113之間的硬件接口的控制邏輯包括兩個子模塊:幀圖像寫入控制器和乒乓開關,這兩種功能可由一塊cpld來完成。 在視頻卡設計
口的總體功能和工作模式;通過設置fsx/dx/clkx端口控制寄存器和fsr/dr/clkr端口控制寄存器來控制串口6個引腳的功能,可以軟件設置每個引腳為通用的i/o引腳或串口通信引腳。tms320c32有兩根通用的i/o引腳為xf0和xf1,由于共享存儲器接口電路需要4根控制線來進行dsp與mcu間的握手通信,這里把串口的2個引腳fsr0和fsx0設置為通用的i/o引腳用作控制線。接口電路原理圖如圖1所示。 圖中ram0~ram3是四片容量為512k的8位高速ram(芯片型號為cy7c1049-17vc),組成32位數據寬度的存儲器,dsp運行時的程序和數據都在這四片ram中。flash(芯片型號為am29f016)用于存儲程序和初始化數據,即使掉電內容也不丟失,dsp上電時由自帶的boot loader程序從flash中取出程序到四片ram中運行。從共享存儲器讀取的采集數據也暫存到這四片ram中。 1.2 數據采集板硬件接口電路 基于單片機at89c51的數據采集板在單片機的全局控制下,通過對多路聲傳感器輸出的微弱信號進行程控放大、低通濾波、同步采樣保持、a/d變換,實
來控制串口的總體功能和工作模式;通過設置fsx/dx/clkx端口控制寄存器和fsr/dr/clkr端口控制寄存器來控制串口6個引腳的功能,可以軟件設置每個引腳為通用的i/o引腳或串口通信引腳。tms320c32有兩根通用的i/o引腳為xf0和xf1,由于共享存儲器接口電路需要4根控制線來進行dsp與mcu間的握手通信,這里把串口的2個引腳fsr0和fsx0設置為通用的i/o引腳用作控制線。接口電路原理圖如圖1所示。 圖中ram0~ram3是四片容量為512k的8位高速ram(芯片型號為cy7c1049-17vc),組成32位數據寬度的存儲器,dsp運行時的程序和數據都在這四片ram中。flash(芯片型號為am29f016)用于存儲程序和初始化數據,即使掉電內容也不丟失,dsp上電時由自帶的boot loader程序從flash中取出程序到四片ram中運行。從共享存儲器讀取的采集數據也暫存到這四片ram中。 1.2 數據采集板硬件接口電路 基于單片機at89c51的數據采集板在單片機的全局控制下,通過對多路聲傳感器輸出的微弱信號進行程控放大、低通濾波、同步采樣保持、a/d變換,實時同步采集多
的總體功能和工作模式;通過設置fsx/dx/clkx端口控制寄存器和fsr/dr/clkr端口控制寄存器來控制串口6個引腳的功能,可以軟件設置每個引腳為通用的i/o引腳或串口通信引腳。tms320c32有兩根通用的i/o引腳為xf0和xf1,由于共享存儲器接口電路需要4根控制線來進行dsp與mcu間的握手通信,這里把串口的2個引腳fsr0和fsx0設置為通用的i/o引腳用作控制線。接口電路原理圖如圖1所示。 圖中ram0~ram3是四片容量為512k的8位高速ram(芯片型號為cy7c1049-17vc),組成32位數據寬度的存儲器,dsp運行時的程序和數據都在這四片ram中。flash(芯片型號為am29f016)用于存儲程序和初始化數據,即使掉電內容也不丟失,dsp上電時由自帶的boot loader程序從flash中取出程序到四片ram中運行。從共享存儲器讀取的采集數據也暫存到這四片ram中。 1.2 數據采集板硬件接口電路 基于單片機at89c51的數據采集板在單片機的全局控制下,通過對多路聲傳感器輸出的微弱信號進行程控放大、低通濾波、同步采樣保持、a/d變換,實
產品型號:CY7C1049CV33-15ZXI
位密度:4M
組織結構:512K x 8
工作電壓(V):3.300
速度(ns):15
封裝/溫度(℃):44TSOP II/-40~85
價格/1片(套):暫無
來源:CY7C1049CV33-10VXC的技術參數
產品型號:CY7C1049CV33-10VXC 請教讀寫sram的問題本人用cpld擴展了兩塊sram,在編寫verilog程序讀寫sram時總是出問題。當我寫入一個確定的數時比如0x89,有時就能正確地讀出來,有時就不行;而且當我把讀出來的這個數傳到處理器中的時候,0x89就變成了0xd9,第4和6位總是為1,不知道為什么??我用的sram是cy7c1049,我按要求在寫的時候將ce=0,oe=0,we有一個寫信號;讀的時候我將ce=0,oe=0,we=1;有做過的可以指點一下嗎??謝謝
位密度:4M
組織結構:512K x 8
工作電壓(V):3.300
速度(ns):10
封裝/溫度(℃):36(400-Mil)SOJ/0~70
價格/1片(套):暫無
來源:請教讀寫SRAM的問題
CY7C1049CV33-10VXC CY7C1049CV33-15ZXI CY7C1061AV33 CY7C1061AV33-10ZI CY7C1061AV3310ZXC CY7C1069AV33 cy7c109 CY7C109B-15VC CY7C130 CY7C131
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