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sp程序調試。 2.2 fpga部分設計 因為本系統的邏輯比較復雜，為了有效地減少硬件的體積、提高硬件系統的可靠性，這里把所有的邏輯控制電路、各種存儲器/寄存器的地址譯碼電路都用一塊超大規模現場可編程邏輯門陣列（fpga）xc3090來實現。邏輯控制電路包括：命令寄存器、采樣點數/采樣頻率設定寄存器、中斷申請信號發生器、將a/d結果寫入fifo ram的控制電路、usb及其fifo和a/d fifo狀態檢測電路。 2.3 usb部分設計 tms320vc33與usb控制器an2136sc之間通過雙向fifo 交換數據,握手信號使用an2136sc的pc口。當usb為接收緩沖器時,dsp讀,an2136sc寫;當usb為發送緩沖器時,dsp寫,an2136sc讀。pc(0)～(3)用作二者的讀寫通道,方向可編程確定; pc(4)用于tms320vc33向an2136sc申請中斷;pc(5)用于an2136sc復位usb接收緩沖器;pc(6)用于usb接收器滿標志,若接收器已滿則禁止an2136進一步對usb接收緩沖器寫入;pc(7)用于usb發送緩沖器空標志,若緩沖器已空則禁止a
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