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EDA技術 |
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請問怎樣學習FPGA/CPLD? | zw820506 | 9 | 2024/3/8 19:38:12 |
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[求助]請教高手一個FPGA調試的問題 | mo_jianhao | 3 | 2024/3/8 19:34:21 |
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sos怎么編延時程序? | gllhgpp | 2 | 2024/3/8 19:20:44 |
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我搞到了某公司的QUARTUS使用指南 | zhang123 | 4 | 2024/3/8 19:11:46 |
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為什么always語句不是電平觸發？ | ckz100 | 8 | 2024/3/8 19:10:04 |
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ByteBlasterMV 下載線的原理圖，誰有？ | czm2004 | 3 | 2024/3/8 18:46:57 |
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求助:EWB5.0之波特圖儀怎么個用法!! | zpcom | 3 | 2024/3/8 18:38:12 |
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ISE中，總線和8根單線如何連接？ | xubanghui | 2 | 2024/3/8 18:30:09 |
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FIFO | leo1983 | 3 | 2024/3/7 8:19:19 |
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請問關于fft的ip核使用問題 | zhang_44 | 4 | 2024/3/7 7:54:45 |
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PROREL 99 有個小問題請幫個忙！ | 煙波游徒 | 4 | 2024/3/7 7:37:37 |
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用VHDL描述CPU | zhuxqsx | 3 | 2024/3/7 5:20:14 |
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vhdl 求教 | leo1983 | 8 | 2024/3/7 3:20:47 |
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sed 或vi 替換 | 小翠 | 4 | 2024/3/7 3:18:22 |
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求QUARTUSII5.1 license | hailsh | 7 | 2024/3/7 2:44:44 |
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vhdl和verilog的文件在一個設計里，怎么編譯不能通過！！ | jansea | 6 | 2024/3/7 2:19:44 |
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WDT是數字電路還是模擬電路? | eqyq | 5 | 2024/3/7 1:50:04 |
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在西安有物美價廉的FPGA仿真板子嗎？ | 溫柔的毒藥 | 4 | 2024/3/7 1:39:18 |
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幫我看看maxplus的這個錯誤提示阿 | slp719 | 3 | 2024/3/7 1:21:39 |
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建立網絡表時出現的錯誤 | wangkj | 2 | 2024/3/7 1:18:53 |
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用synplify綜合xilinx的IP核，再用ISE implement就出錯了 | boy364 | 2 | 2024/3/7 0:58:12 |
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FPGA/IC設計交流的熱土 | sunlove | 4 | 2024/3/7 0:17:31 |
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我想在Xilinx的CPLD外部管腳輸入時鐘脈沖。。。 | etiller | 9 | 2024/3/6 23:11:09 |
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為什么我使用的ABEL3.0 GAL編譯器有問題啊?真奇怪 | yangqunyj | 2 | 2024/3/6 23:09:35 |
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問一個Verilog語法方面的問題？想不通了！！！！！！！！！！ | wag | 6 | 2024/3/6 22:47:59 |
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請問關于Quartus II4.1編譯時的問題 | dandan0510 | 23 | 2024/3/6 22:34:32 |
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求助：Protel99學習資料 | boiya | 4 | 2024/3/6 22:02:03 |
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quartus編譯出現警告，不知道是什么意思 | 珊瑚蟲 | 8 | 2024/3/6 21:00:32 |
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CPLD是否能代替譯碼器和鎖存器？ | qianlong30 | 7 | 2024/3/6 20:55:41 |
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用什么工具畫狀態轉移圖？ | limee | 2 | 2024/3/6 20:12:50 |
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